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SY100S838ZITR中文資料麥瑞半導(dǎo)體數(shù)據(jù)手冊PDF規(guī)格書

SY100S838ZITR
廠商型號

SY100S838ZITR

功能描述

(?1, ?2/3) OR (?2, ?4/6) CLOCK GENERATION CHIP

文件大小

73.62 Kbytes

頁面數(shù)量

4

生產(chǎn)廠商 Micrel Semiconductor
企業(yè)簡稱

Micrel麥瑞半導(dǎo)體

中文名稱

麥瑞半導(dǎo)體官網(wǎng)

原廠標(biāo)識
數(shù)據(jù)手冊

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更新時(shí)間

2024-11-8 16:38:00

SY100S838ZITR規(guī)格書詳情

DESCRIPTION

The SY100S838/L is a low skew (÷1, ÷2/3) or (÷2, ÷4/ 6) clock generation chip designed explicitly for low skew clock generation applications. The internal dividers are synchronous to each other, therefore, the common output edges are all precisely aligned. The devices can be driven by either a differential or single-ended ECL or, if positive power supplies are used, PECL input signal. In addition, by using the VBB output, a sinusoidal source can be ACcoupled into the device.

FEATURES

■ 3.3V and 5V power supply options

■ 50ps output-to-output skew

■ Synchronous enable/disable

■ Master Reset for synchronization

■ Internal 75K? input pull-down resistors

■ Available in 20-pin SOIC package

供應(yīng)商 型號 品牌 批號 封裝 庫存 備注 價(jià)格
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