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M2V28S20ATP-6中文資料三菱電機(jī)數(shù)據(jù)手冊(cè)PDF規(guī)格書(shū)

M2V28S20ATP-6
廠商型號(hào)

M2V28S20ATP-6

功能描述

128M Synchronous DRAM

文件大小

743.24 Kbytes

頁(yè)面數(shù)量

51 頁(yè)

生產(chǎn)廠商 Mitsubishi Electric Semiconductor
企業(yè)簡(jiǎn)稱

Mitsubishi三菱電機(jī)

中文名稱

三菱電機(jī)株式會(huì)社官網(wǎng)

原廠標(biāo)識(shí)
數(shù)據(jù)手冊(cè)

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更新時(shí)間

2025-1-3 18:05:00

M2V28S20ATP-6規(guī)格書(shū)詳情

DESCRIPTION

M2V28S20ATP is organized as 4-bank x 8,388,608-word x 4-bit Synchronous DRAM with LVTTL interface and M2V28S30ATP is organized as 4-bank x 4,194,304-word x 8-bit and M2V28S40ATP is organized as 4-bank x 2,097,152-word x 16-bit. All inputs and outputs are referenced to the rising edge of CLK.

M2V28S20ATP,M2V28S30ATP,M2V28S40ATP achieves very high speed data rates up to 133MHz, and is suitable for main memory or graphic memory in computer systems.

FEATURES

- Single 3.3V ±0.3V power supply

- Max. Clock frequency -6:PC133 / -7:PC100 / -8:PC100

- Fully synchronous operation referenced to clock rising edge

- 4-bank operation controlled by BA0,BA1(Bank Address)

- /CAS latency- 2/3 (programmable)

- Burst length- 1/2/4/8/FP (programmable)

- Burst type- Sequential and interleave burst (programmable)

- Byte Control- DQML and DQMU (M2V28S40ATP)

- Random column access

- Auto precharge / All bank precharge controlled by A10

- Auto and self refresh

- 4096 refresh cycles /64ms

- LVTTL Interface

- Package

M2V28S20ATP/30ATP/40ATP 400-mil, 54-pin Thin Small Outline (TSOP II) with 0.8mm lead pitch

產(chǎn)品屬性

  • 型號(hào):

    M2V28S20ATP-6

  • 制造商:

    MITSUBISHI

  • 制造商全稱:

    Mitsubishi Electric Semiconductor

  • 功能描述:

    128M Synchronous DRAM

供應(yīng)商 型號(hào) 品牌 批號(hào) 封裝 庫(kù)存 備注 價(jià)格
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