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IDT5V2528APGG集成電路（IC）的時(shí)鐘發(fā)生器PLL頻率合成器規(guī)格書PDF中文資料
| 廠商型號(hào) |
IDT5V2528APGG |
| 參數(shù)屬性 | IDT5V2528APGG 封裝/外殼為28-TSSOP（0.173"，4.40mm 寬）；包裝為管件；類別為集成電路（IC）的時(shí)鐘發(fā)生器PLL頻率合成器；產(chǎn)品描述：IC CLK DVR ZD BUFFER PLL 28TSSOP |
| 功能描述 | 2.5V / 3.3V PHASE-LOCK LOOP CLOCK DRIVER ZERO DELAY BUFFER |
| 封裝外殼 | 28-TSSOP（0.173"，4.40mm 寬） |
| 文件大小 |
61.64 Kbytes |
| 頁(yè)面數(shù)量 |
7 頁(yè) |
| 生產(chǎn)廠商 | Integrated Device Technology, Inc. |
| 企業(yè)簡(jiǎn)稱 |
IDT |
| 中文名稱 | Integrated Device Technology, Inc.官網(wǎng) |
| 原廠標(biāo)識(shí) |  |
| 數(shù)據(jù)手冊(cè) | |
| 更新時(shí)間 | 2025-5-24 23:01:00 |
| 人工找貨 | IDT5V2528APGG價(jià)格和庫(kù)存，歡迎聯(lián)系客服免費(fèi)人工找貨 |
IDT5V2528APGG規(guī)格書詳情
DESCRIPTION:
The IDT5V2528 is a high performance, low-skew, low-jitter, phase-lock loop (PLL) clock driver. It uses a PLL to precisely align, in both frequency and phase, the feedback (FBOUT) output to the clock (CLK) input signal.
FEATURES:
? Operates at 3.3V VDD/AVDD and 2.5V/3.3V VDDQ
? 1:10 fanout
? 3-level inputs for output control
? External feedback (FBIN) pin is used to synchronize the outputs to the clock input signal
? No external RC network required for PLL loop stability
? Configurable 2.5V or 3.3V LVTTL outputs
? tPD Phase Error at 100MHz to 166MHz: ±150ps
? Jitter (peak-to-peak) at 133MHz and 166MHz: ±75ps
? Spread spectrum compatible
? Operating Frequency:
? Std: 25MHz to 140MHz
? A: 25MHz to 167MHz
? Available in TSSOP package
產(chǎn)品屬性
- 產(chǎn)品編號(hào)：
IDT5V2528APGGI8
- 制造商：
Renesas Electronics America Inc
- 類別：
集成電路（IC） > 時(shí)鐘發(fā)生器，PLL，頻率合成器
- 包裝：
管件
- 類型：
PLL 時(shí)鐘驅(qū)動(dòng)器，零延遲緩沖器
- PLL：
帶旁路
- 輸入：
時(shí)鐘
- 輸出：
LVTTL
- 比率 - 輸入：
1：10
- 差分 - 輸入：
無/無
- 頻率 - 最大值：
167MHz
- 分頻器/倍頻器：
無/無
- 電壓 - 供電：
3V ~ 3.6V
- 工作溫度：
-40°C ~ 85°C
- 安裝類型：
表面貼裝型
- 封裝/外殼：
28-TSSOP（0.173"，4.40mm 寬）
- 供應(yīng)商器件封裝：
28-TSSOP
- 描述：
IC CLK DVR ZD BUFFER PLL 28TSSOP
| 供應(yīng)商 | 型號(hào) | 品牌 | 批號(hào) | 封裝 | 庫(kù)存 | 備注 | 價(jià)格 |
|---|---|---|---|---|---|---|---|
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