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CY7C1327B-100AC中文資料賽普拉斯數(shù)據(jù)手冊(cè)PDF規(guī)格書

CY7C1327B-100AC
廠商型號(hào)

CY7C1327B-100AC

功能描述

256K x 18 Synchronous-Pipelined Cache RAM

文件大小

596.86 Kbytes

頁面數(shù)量

17

生產(chǎn)廠商 CypressSemiconductor
企業(yè)簡稱

Cypress賽普拉斯

中文名稱

賽普拉斯半導(dǎo)體公司官網(wǎng)

原廠標(biāo)識(shí)
數(shù)據(jù)手冊(cè)

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更新時(shí)間

2024-11-16 22:59:00

CY7C1327B-100AC規(guī)格書詳情

Functional Description

The CY7C1327B is a 3.3V, 256K by 18 synchronous-pipelined cache SRAM designed to support zero wait state secondary cache with minimal glue logic.

Features

? Supports 100-MHz bus for Pentium? and PowerPC? operations with zero wait states

? Fully registered inputs and outputs for pipelined operation

? 256K by 18 common I/O architecture

? 3.3V core power supply

? 2.5V / 3.3V I/O operation

? Fast clock-to-output times

— 3.5 ns (for 166-MHz device)

— 4.0 ns (for 133-MHz device)

— 5.5 ns (for 100-MHz device)

? User-selectable burst counter supporting Intel? Pentium interleaved or linear burst sequences

? Separate processor and controller address strobes

? Synchronous self-timed writes

? Asynchronous Output Enable

? JEDEC-standard 100 TQFP pinout

? “ZZ” Sleep Mode option and Stop Clock option

供應(yīng)商 型號(hào) 品牌 批號(hào) 封裝 庫存 備注 價(jià)格
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