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CY7C1324H-133AXI中文資料賽普拉斯數(shù)據(jù)手冊PDF規(guī)格書

CY7C1324H-133AXI
廠商型號

CY7C1324H-133AXI

功能描述

2-Mbit (128K x 18) Flow-Through Sync SRAM

文件大小

678.94 Kbytes

頁面數(shù)量

15

生產(chǎn)廠商 CypressSemiconductor
企業(yè)簡稱

Cypress賽普拉斯

中文名稱

賽普拉斯半導(dǎo)體公司官網(wǎng)

原廠標(biāo)識
數(shù)據(jù)手冊

下載地址一下載地址二到原廠下載

更新時間

2024-11-12 18:08:00

CY7C1324H-133AXI規(guī)格書詳情

Functional Description[1]

The CY7C1324H is a 128K x 18 synchronous cache RAM designed to interface with high-speed microprocessors with minimum glue logic. Maximum access delay from clock rise is 6.5 ns (133-MHz version). A 2-bit on-chip counter captures the first address in a burst and increments the address automatically for the rest of the burst access.

Features

? 128K x 18 common I/O

? 3.3V core power supply

? 3.3V/2.5V I/O supply

? Fast clock-to-output times

— 6.5 ns (133-MHz version)

? Provide high-performance 2-1-1-1 access rate

? User-selectable burst counter supporting Intel? Pentium? interleaved or linear burst sequences

? Separate processor and controller address strobes

? Synchronous self-timed write

? Asynchronous output enable

? Offered in JEDEC-standard lead-free 100-pin TQFP package

? “ZZ” Sleep Mode option

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